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| 도서설명 |
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목차 |
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저자/역자 정보 |
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독자서평 |
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예제소스 |
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정오표 |
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이 책은 컴퓨터공학 전자공학 전기공학을 전공하는 학생들에게 디지털회로 설계분야의 지식을 소개하고 스스로 설계능력을 갖추도록 계획되었다. 저자가 다년간 강의해 온 디지털회로 설계와 디지털회로 응용과목에서 강의한 내용들을 정리하였으며 제 1 장부터 제 4 장까지는 국내의 대표적인 설계 툴인 Mycad 중 Mylogic-station을 이용한 설계와 시뮬레이션을 중점적으로 다뤘다. 학부에서 디지털공학을 이수한 학부 3-4학년 학생들에게 적당할 것으로 생각되며 내용적으로 조합논리와 순차논리를 나눠서 설명하였다.
그러나 시뮬레이션은 장차 설계하고자 하는 회로시스템의 예측을 통해 실제 설계에 들어 갈 수 있는 중요한 단계임에는 부언할 필요가 없지만 더욱 중요한 것은 실물로 회로를 구현하는 능력이 더욱 중요하다고 하겠다. 실제로 회로를 구현하는 방법은 다양한 방법이 있다. 예를 들면 gate-level VHDL을 통한 FPGA ASIC 등 용도에 따라 구현 대상은 많으나 현실적으로 몇 10만 GATE 이상이 되는 소자를 사용하는 것은 학부과정에서는 별로 의미가 없다고 생각된다.
대규모 소자는 기본을 충분히 익힌 후에 실제 상품개발을 하는 필드에서 적용하는 것이 옳다고 생각한다. 그래서 이 책에서는 PLD를 설계 대상으로 하였으며 그 중에서도 GAL소자를 중심으로 설계하도록 하였다. 사용한 툴은 MyPLD를 사용하였고 툴은 공개 버젼이므로 학생들에게 부담없이 사용할 수 있을 것이다. 강의 중에 늘 학생들에게 강조하는 내용이지만 자신이 필요한 회로를 자신이 직접 설계하여 구현하는 능력을 가지는 것이 중요하며 이를 위해 PLD는 상당한 강점이 있다. PC상에서 설계하고 프로그램 장치를 통해 스스로 구현하여 실물로 만드는 것은 하드웨어를 전공하는 학생들에겐 상당한 즐거움이 될 것이며 이 책이 그러한 학생들에게 조그만 도움이 되는 지침서가 되기를 기대한다.
2007년 1월 저자
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1장 ≫≫ Mycad
1.1 MyCAD Introduction
1.1.1 MyCAD Tool Set
1.2 Installation Guide
1.2.1 System 요구사항
1.2.2 설치 방법
1) MyCAD 설치 Program 실행
2) Version 선택
3) 설치 제품 선택
4) MyVHDL 설치 Directory지정
5) Program Group 지정
6) 최종 사용자 계약사항 안내
7) 설치 시작
8) MyCad 설치 완료
2장 ≫≫ Mylogic-Station
2.1 MyLogic 시작하기
2.2 새 디자인 만들기
2.3 라이브러리 이용 및 설정
2.4 스키매틱 편집기 사용법
2.5 회로도 검사(Electrical Rule Check)
1) 회로 검색 기능 실행
2) 오류수정
3) 저장하기
2.6 시뮬레이터 사용법
2.7 계층 구조 설계
1) 심볼 만들기
2) 심볼 포트 그리기
3) 심볼 포트 속성 편집
4) 객체 그리기
5) 그 밖의 기능
2.8 Truth Table
2.8.1 Truth Table이란...
2.8.2 Truth Table 사용방법
2.8.3 Truth Table로 Design된 회로의 검증
2.9 State Table
2.9.1 State Table 이란...
2.9.2 State Table 사용법
3장 ≫≫ 조합논리회로의 설계
3.1 반가산기(Half Adder)의 설계
3.2 2진 전가산기(Full Adder)의 설계
3.3 2비트 2진 가산기 설계
3.4 4비트 가ㆍ감산기(4-bit AdderSubtracter)의 설계
3.5 10진-BCD 인코더 설계
3.5.1 10진-BCD 인코더 논리 회로도
3.5.2 10진-BCD 인코더 심볼
3.5.3 10진-BCD 인코더의 논리 시뮬레이션
3.6 BCD-10진 디코더 설계
3.6.1 BCD-10진 디코더 논리 회로도
3.6.2 BCD-10진 디코더의 심볼
3.6.3 BCD-10진 디코더의 논리 시뮬레이션
3.7 3과 4의 배수표현 90
3.7.1 3과 4의 배수표현 진리표
3.7.2 3과 4의 배수표현 회로도
3.7.3 3과 4의 배수표현 논리 시뮬레이션
3.8 BCD-7-세그먼트 디코더 설계
3.8.1 BCD-7-세그먼트 진리표
3.8.2 BCD-7-세그먼트 회로도
3.8.3 BCD-7-세그먼트 논리 시뮬레이션
3.9 4X1 멀티플렉서의 설계
3.9.1 4X1 멀티플렉서 회로도
3.9.2 4X1 멀티플렉서 심볼
3.9.3 4X1 멀티플렉서의 논리 시뮬레이션
3.10 1X4 디멀티플렉서의 설계
3.10.1 1X4 디멀티플렉서 회로도
3.10.2 1X4 디멀티플렉서 심볼
3.10.3 1X4 디멀티플렉서의 논리 시뮬레이션
4장 ≫≫ 순차회로의 설계
4.1 래치(latch)
4.2 플립플롭 개요
4.3 SR 플립플롭
4.4 D 플립플롭
4.5 JK 플립플롭
4.6 T 플립플롭
4.7 비동기식 Preset Clear 단자를 갖는 플립플롭
4.8 플립플롭 타이밍 파라미터
4.9 플립플롭의 설계
4.9.1 SR 래치 설계
4.9.2 SR 래치 논리 회로도
4.9.3 SR 래치의 논리 시뮬레이션
4.10 JK 플립플롭
4.10.1 JK 플립플롭의 논리 회로도
4.10.2 JK 플립플롭의 논리 시뮬레이션
4.11 D 플립플롭 설계
4.11.1 D 플립플롭 논리 회로도
4.11.2 D 플립플롭 논리 시뮬레이션
4.12 T 플립플롭 설계
4.12.1 T 플립플롭 논리 회로도
4.12.2 T 플립플롭 논리 시뮬레이션
4.13 4 비트 동기식 2진 카운터 설계
4.13.1 4 비트 동기식 2진 카운터 논리 회로도
4.13.2 4 비트 동기식 2진 카운터 시뮬레이션 결과
5장 ≫≫ 논리회로 설계응용
5.1 PLD(Programmable Logic Devices)의 개요
(1) PROM (Programmable Read-Only Memory)
(2) EPROM (Erasable Programmable Read Only Memory)
(3) EEPROM (Electrically Erasable Programmable Read Only Memory)
(4) PAL (Programmable Array Logic)
(5) GAL (Generic Array Logic)
5.2 PLD(Programmable Logic Devices)의 구조
(1) PAL의 종류 및 구조
(2) GAL의 종류 및 구조
5.3 PLD 설계 방법
6장 ≫≫ MyPLD의 사용법
6.1 MyPLD
6.2 MyPLD의 설치 및 실행 방법
(1) MyPLD의 설치
(2) MyPLD를 이용한 설계 과정
(3) MyPLD의 실행 메뉴별 기능
6.3 MyPLD의 사용 예
6.3.1 조합논리회로의 설계
(1) 3x8 디코더의 부울식(boolean equation) 작성
(2) MyPLD에 작성한 부울식을 입력
(3) 작성된 부울식 저장하기
(4) MyPLD에 소자 선택
(5) 핀 할당
(6) JEDEC 파일 생성
(7) PLD 소자에 프로그램 하기
6.3.2 순차 회로 설계(4비트 동기식 카운터)
(1) 4비트 동기식 카운터의 부울식 작성
6.4 LOGIC LAB UNIT
6.4.1 LOGIC LAB의 사용
6.4.2 PANEL의 기능 설명
(1) POWER 스위치
(2) BUZZER
(3) 60Hz 출력
(4) 가변저항기 500KΩ 10KΩ
(5) +5V 및 -5V 출력
(6) 전류계
(7) COMMON MODE 스위치
(8) LED 인디케이터
(9) Hexadecimal Number 디스플레이
(10) 전압계
(11) 펄스 출력 짹
(12) 푸쉬버튼 Logic 스위치
(13) Data 스위치
(14) 푸쉬버튼 스위치
7장 ≫≫ PLD를 이용한 설계 실험
7.1 2비트 비교기
7.2 BCD 7-세그먼트 디코더
7.3 2비트 가산기
7.4 Binary to ASCII 변환기
7.5 3비트 UP DOWN 카운터
7.6 4비트 시프트 레지스터
7.7 신호등 제어기(교차로) 설계
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